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L'objet du standard JESD204 est d'augmenter le débit des liens entre convertisseurs de données et FPGA. Avalisée en juillet 2011, la version B de la norme permet de monter jusqu'à 12,5Gbit/s par lien. Elle ajoute par ailleurs des fonctions de première importance, comme la latence déterministe.
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La récupération d'énergie et la transmission de données dans les deux sens via la prise jack audio d'un smartphone permet de concevoir des accessoires évolués ne nécessitant pas de batterie et de s'affranchir des ports de données propriétaires.
Publié dans Revue ElectroniqueS
Traditionnellement, lorsqu'il s'agit de choisir un régulateur de tension linéaire, un juste équilibre entre le courant de repos et les performances dynamiques doit être trouvé. Grâce aux technologies avancées et à la mise en œuvre de techniques de conception sophistiquées dans les LDO de dernière génération, il est aujourd'hui possible de minimiser un tel compromis.
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lundi, 01 juillet 2013 00:00

Cna 18 Bits De Précision

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lundi, 01 juillet 2013 00:00

Mémoire Sram 32 Mbit

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Composants
Barrette de diode laser pulsée de haute puissance Adaptées pour des conditions d’utilisation critiques grâce à leur dissipation thermique et une [...]
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