La version 6.2 de l’environnement de vérification Questa de Mentor Graphics s’appuie sur une méthodologie non-propriétaire implantée en langages SystemC et SystemVerilog.
Remonter pour d’un niveau d’abstraction concevoir les puces de dernière génération devient une nécessité pour les équipes de conception. Pour ce faire, l’écriture de modèles de circuits au niveau transactionnel, ou TLM pour
…