Dans les conceptions actuelles de SoC, l’utilisation de blocs IP existant est en pleine progression. Parallèlement, la complexité croissante des circuits impose d’élever le niveau d’abstraction de la conception et de s’appuyer sur des plates-formes logicielles qui travaillent au niveau TLM (Transaction level modeling), comme celles développées chez STMicroelectronics (2). Malheureusement, un des freins à
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