Riviera IPT d’Aldec

Cet environnement de simulation en langage mixte inclut des outils de débogage et de covérification pour les projets embarqués logiciels et matériels autour d’un cœur ARM.

Accélérateur matériel pour une simulation de la conception proche du MHz
Débogueur logiciel d’ARM
Accès à tous les états logiques du système
Testbench utilisés en Verilog,

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