AXI Systems Components d’ARM
Cet ensemble de blocs de propriété intellectuelle a pour objectif d’assurer une liaison optimisée entre le processeur et la mémoire externe d’un SoC externe via la mémoire cache et le contrôleur mémoire.
Composant contrôleur mémoire de niveau 2
Matrice d’interconnexion configurable doté d’un débit de 1,6 Go par maître à 200 MHz
Contrôleur
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