Compiler for Assertion-based Verification, de 0-In Design

Ce compilateur de programmes d’assertions accepte en entrée plusieurs langages d’assertion et génère en sortie des assertions synthétisables en code Verilog.

Support des assertions issues de la bibliothèque CheckerWare, du Verilog 1394 et de l’OVL
Support prévu pour les langages PSL et Verilog 3.1
Gestion des assertions en

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