Le développement rapide et fiable d’un Asic complexe dont le volume de production est trop faible pour amortir le budget d’une solution précaractérisée et trop élevé pour supporter le coût à l’unité d’un FPGA : voilà le défi que les réseaux structurés relèvent depuis quelques années. Dans les technologies nanométriques, l’enjeu est de taille comme l’illustre

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